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问答题

用Verilog HDL 参数化设计的方法描述一个SIZE位的三态缓冲器
module Buffer # (parameter SIZE=4)
 ( output [SIZE-1:0] Dout,
   input [SIZE-1:0] Din, 
   input En );
assign Dout = En ? Din : ________; 
endmodule

【参考答案】

{SIZE{1'bz}}或{SIZE{1'bZ}}

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